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NCP1631
Vout low
detect
0.955*Vref
pfcOK
230 m A
VD D
Internal
Thermal
Shutdown
TS D
SHDN
Vref
VD D
Iref
Regul
Vcc
FB
Error Amplifier
± 20 m A
Vref
UVP
BO_NOK
IRt_low
Vcc_OK
Vcc(on)
Vcontrol
OVLflag1
UVLO
Vcc(off)
pfcOK
( 0.6 V cl amp vo ltag e Fault
BO_NOK
V BOcomp
i s acti vated)
OC P
V REGUL
4R
CLK2
DT In ? rush
S
V BOcomp
L pwm2
Vpwm2
pfcOK
Ou tpu t
S
I CH
Vpwm1
Q
L pwm1
FFOLD
Rt
OF F
3V
I FF
Generation of the oscillator
charge current I FF as a
function of V REGUL
(frequency fold ? back)
I Rt < 7 m A IRt_low
Generation of the charge
current for the internal
timing capacitors (max
on ? time setting for the
two phases)
5R
SK I P
management
OVP V BO
OFF Vcc
Vton
circuitry
DRV1 DRV2 Vton
On ? time control
phases Vpwm2 R
OF F
In ? rush
SKIP
CLK1 Vcc
In ? rush
for the two Vpwm1
STOP Buffer 1
STO P Brown ? out
detection with
50 ? ms delay
processing Q
R
STOP Buffer 2
Ou tpu t
BO
DRV2
DRV1
V DMG2
DT
ZCD2
ZCD1
V BO
detection for
phase 2 DRV2
V DMG1
Zero current
detection for
Zero current V ZCD2
V ZCD1
phase 1 DRV1
All the RS latches are
RESET dom inant
OFF
CLK1
CLK2
S
Lstup Q
Oscillator block
with interleaving and
frequency foldback
V ZCD1 V ZCD2
I FF
REF5V
Stup OFF
In ? rush
pfcOK
OSC
pfcOK/
REF5V
OVLflag1
R
OVP
12% Vr ef
UVP
Current Sense Block
(Building of I CS
proportional to I COIL )
+
OVP
OC P
I CS > 210 m A
Ics
Vovp = Vref
?
In ? rush
I CS > 14 m A
CS
Latch
BO_NOK
Vcc_OK
Vcc < Vcc(r eset)
Vr ef
R
L SHDN Q
S
SHDN
Q ZCD1
Q ZCD2
DRV1
DRV2
GND
Figure 2. Functional Block Diagram
http://onsemi.com
7
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